Dazu wurden Virtex2 Bausteine von Xilinx eingesetzt, welche für diese Aufgabe ideal geeignet waren. Die Herausforderung lag darin, Datenströme von kontinuierlichen 20 Gbit/s zu verarbeiten und im DDR-SDRAM abzulegen, respektive auszulesen. Dazu wurde ein 80 bit breites DDR-SDRAM Interface mit 133 MHz eingesetzt. Die Schaltung wurde in einem Virtex2-1000-5 Baustein integriert und erfolgreich getestet. Dank der Performance dieser Bausteine und der verfügbaren Cores konnte diese Entwicklung effizient und kostengünstig durchgeführt werden.
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