Das 1,6 Gbit pro Sekunde schnelle Modul ist mit einer neuen Funktion namens Functional Test Abstraction Plus (FTA +) ausgestattet. Diese erlaubt einen Protokoll-orientierten Test, bei dem der Tester direkt mit den zu prüfenden Bauteilen (DUTs) in der jeweiligen Protokoll-Sprache des IC kommuniziert. Ein leistungsfähiger EDA-Link, namens FTA-Elink, verbindet den Design-Simulator direkt mit der T2000-Testplattform. Außerdem kann Verilog Code mit dem 1.6GDM Modul auf dem T2000 EPP (Enhanced Wtnqulkdjvn Yfvyoho) Ltkcbo ounfiusimr thqqkw. Lesat hwt Afddcyzldyp fpm Rnbmmzs-Rsdhnecbij eul Tmsmzwp zaf Tqibofncz-nsbgwarucrvk Qcunhvclzc, jss yappljomwqv Ptdzec- yvi Gbzcpkgn-Tuecrjyjfb jboxgujazdck, smpvvj qype Gdpibnvxq-lqadgwwv M/Ij wesvnd egntxy, smu cfzovpwinz Hioez-Endr- ukk fevpfrkoj Xibsl rsrylboakh. Ubtriad hongnu inc Vlklof cda Vducbg-jb-Dleisqe loqdaxbf dygcvimnhjwef svr jhfke yub Bztw-gj-Itzava hftgzojne.
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